Références fabricant

Alliance Memory SDRAM 256 MB Surface, 54-Pin 16 bit TSOP

N° de stock RS:: 230-8417
Référence fabricant:: AS4C16M16SA-6TINTR
Fabricant:: Alliance Memory

Alliance Memory SDRAM 256 MB Surface, 54-Pin 16 bit TSOP

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N° de stock RS:: 230-8417
Référence fabricant:: AS4C16M16SA-6TINTR
Fabricant:: Alliance Memory

Spécifications

Documentation technique

Législations et de normes

Détails du produit

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Sélectionner tout	Attribut	Valeur
	Marque	Alliance Memory
	Product Type	SDRAM
	Memory Size	256MB
	Organisation	16M x 16 Bit
	Data Bus Width	16bit
	Address Bus Width	13bit
	Maximum Clock Frequency	166MHz
	Number of Bits per Word	16
	Maximum Random Access Time	5ns
	Number of Words	4M
	Mount Type	Surface
	Package Type	TSOP
	Minimum Operating Temperature	-40°C
	Pin Count	54
	Maximum Operating Temperature	85°C
	Length	22.35mm
	Series	AS4C16M16SA-C&I
	Width	10.29 mm
	Height	1.2mm
	Standards/Approvals	No
	Minimum Supply Voltage	3V
	Automotive Standard	No
	Maximum Supply Voltage	3.6V
	Supply Current	60mA

	Sélectionner tout
	Marque Alliance Memory
	Product Type SDRAM
	Memory Size 256MB
	Organisation 16M x 16 Bit
	Data Bus Width 16bit
	Address Bus Width 13bit
	Maximum Clock Frequency 166MHz
	Number of Bits per Word 16
	Maximum Random Access Time 5ns
	Number of Words 4M
	Mount Type Surface
	Package Type TSOP
	Minimum Operating Temperature -40°C
	Pin Count 54
	Maximum Operating Temperature 85°C
	Length 22.35mm
	Series AS4C16M16SA-C&I
	Width 10.29 mm
	Height 1.2mm
	Standards/Approvals No
	Minimum Supply Voltage 3V
	Automotive Standard No
	Maximum Supply Voltage 3.6V
	Supply Current 60mA

Datasheet - AS4C16M16SA-6TINTR

The Alliance Memory 256Mb SDRAM is a high-speed CMOS synchronous DRAM containing 256 Mbits. It is internally configured as 4 Banks of 4M word x 16 DRAM with a synchronous interface (all signals are registered on the positive edge of the clock signal, CLK). Read and write accesses to the SDRAM are burst oriented; accesses start at a selected location and continue for a programmed number of locations in a programmed sequence. Accesses begin with the registration of a BankActivate command which is then followed by a Read or Write command.

Fast access time from clock: 5/5.4 ns

Fast clock rate: 166/143 MHz

Fully synchronous operation

Internal pipelined architecture

4M word x 16-bit x 4-bank

Alliance Memory SDRAM 256 MB Surface, 54-Pin 16 bit TSOP

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