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Alliance Memory SDRAM 2 GB Surface, 84-Pin 16 bit FBGA

N° de stock RS:: 230-8409
Référence fabricant:: AS4C128M16D2A-25BCN
Fabricant:: Alliance Memory

Alliance Memory SDRAM 2 GB Surface, 84-Pin 16 bit FBGA

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Unité	Prix par unité	le plateau*
209 - 209	13,297 €	2 779,07 €
418 - 418	12,947 €	2 705,92 €
627 - 836	12,615 €	2 636,54 €
1045 +	12,30 €	2 570,70 €

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N° de stock RS:: 230-8409
Référence fabricant:: AS4C128M16D2A-25BCN
Fabricant:: Alliance Memory

Spécifications

Documentation technique

Législations et de normes

Détails du produit

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Sélectionner tout	Attribut	Valeur
	Marque	Alliance Memory
	Product Type	SDRAM
	Memory Size	2GB
	Organisation	128M x 16
	Data Bus Width	16bit
	Address Bus Width	13bit
	Number of Bits per Word	16
	Maximum Clock Frequency	400MHz
	Maximum Random Access Time	12.5ns
	Mount Type	Surface
	Package Type	FBGA
	Pin Count	84
	Minimum Operating Temperature	0°C
	Maximum Operating Temperature	85°C
	Width	12.5 mm
	Height	1.2mm
	Length	8.1mm
	Series	AS4C128M16D2A
	Standards/Approvals	RoHS
	Automotive Standard	No
	Minimum Supply Voltage	1.7V
	Maximum Supply Voltage	1.9V

	Sélectionner tout
	Marque Alliance Memory
	Product Type SDRAM
	Memory Size 2GB
	Organisation 128M x 16
	Data Bus Width 16bit
	Address Bus Width 13bit
	Number of Bits per Word 16
	Maximum Clock Frequency 400MHz
	Maximum Random Access Time 12.5ns
	Mount Type Surface
	Package Type FBGA
	Pin Count 84
	Minimum Operating Temperature 0°C
	Maximum Operating Temperature 85°C
	Width 12.5 mm
	Height 1.2mm
	Length 8.1mm
	Series AS4C128M16D2A
	Standards/Approvals RoHS
	Automotive Standard No
	Minimum Supply Voltage 1.7V
	Maximum Supply Voltage 1.9V

Datasheet - AS4C128M16D2A-25BCN

The Alliance Memory 2Gb DDR2 is a high-speed CMOS Double-Data- Rate-Two (DDR2), synchronous dynamic random - access memory (SDRAM) containing 2048 Mbits in a 16- bit wide data I/Os. It is internally configured as a 8-bank DRAM, 8 banks x 16Mb addresses x 16 I/Os. The device is designed to comply with DDR2 DRAM key features such as posted CAS# with additive latency, Write latency = Read latency -1, Off-Chip Driver (OCD) impedance adjustment, and On Die Termination(ODT).

8 internal banks for concurrent operation

4-bit prefetch architecture

Internal pipeline architecture

Precharge & active power down

Programmable Mode & Extended Mode registers

Alliance Memory SDRAM 2 GB Surface, 84-Pin 16 bit FBGA

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