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Micron MT41K256M16TW-107 IT:P SDRAM 4 GB Surface Mount, 96-Pin 16 bit FBGA

N° de stock RS:: 696-909
Référence fabricant:: MT41K256M16TW-107 IT:P
Fabricant:: Micron

Micron MT41K256M16TW-107 IT:P SDRAM 4 GB Surface Mount, 96-Pin 16 bit FBGA

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N° de stock RS:: 696-909
Référence fabricant:: MT41K256M16TW-107 IT:P
Fabricant:: Micron

Spécifications

Documentation technique

Législations et de normes

Détails du produit

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Sélectionner tout	Attribut	Valeur
	Marque	Micron
	Memory Size	4GB
	Product Type	SDRAM
	Organisation	256M x 16
	Data Bus Width	16bit
	Address Bus Width	15bit
	Number of Bits per Word	16
	Maximum Clock Frequency	933MHz
	Maximum Random Access Time	13.91ns
	Number of Words	256 Meg
	Mount Type	Surface Mount
	Package Type	FBGA
	Pin Count	96
	Minimum Operating Temperature	-40°C
	Maximum Operating Temperature	95°C
	Width	8mm
	Height	1.2mm
	Standards/Approvals	RoHS
	Series	MT41K
	Length	14mm
	Supply Current	46mA
	Minimum Supply Voltage	1.28V
	Maximum Supply Voltage	1.45V
	Automotive Standard	No

	Sélectionner tout
	Marque Micron
	Memory Size 4GB
	Product Type SDRAM
	Organisation 256M x 16
	Data Bus Width 16bit
	Address Bus Width 15bit
	Number of Bits per Word 16
	Maximum Clock Frequency 933MHz
	Maximum Random Access Time 13.91ns
	Number of Words 256 Meg
	Mount Type Surface Mount
	Package Type FBGA
	Pin Count 96
	Minimum Operating Temperature -40°C
	Maximum Operating Temperature 95°C
	Width 8mm
	Height 1.2mm
	Standards/Approvals RoHS
	Series MT41K
	Length 14mm
	Supply Current 46mA
	Minimum Supply Voltage 1.28V
	Maximum Supply Voltage 1.45V
	Automotive Standard No

Datasheet - MT41K256M16TW-107 IT:P

Pays d'origine :: TW

The Micron DDR3 SDRAM uses a double data rate architecture to achieve high-speed operation. The double data rate architecture is an 8n-prefetch architecture with an Interface designed to transfer two data words per clock cycle at the I/O pins. A single read or write operation for the DDR3 SDRAM effectively consists of a single 8n-bit-wide, four-clock cycle data transfer at the internal DRAM core and eight corresponding n-bit-wide, one half-clock-cycle data transfers at the I/O pins.

Self refresh temperature

Automatic self refresh

Multipurpose register

RoHS compliant

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